News - 50 Prozent mehr Kerne und Cache: Tachyum baut neue Luftschlösser in EDA-Tools

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192 Kerne statt geplanter 128, dazu auch 50 Prozent mehr Cache – Tachyum baut in neuen EDA-Tools auch neue Luftschlösser. Dass es einmal bei maximal 64 Kernen angefangen hat, liegt schon Jahre zurück. Aber mehr als diese Ankündigungen gibt es bisher immer noch nicht, echtes Silizium bleibt eine...

Wie soll eine CPU x86 und RISC gleichzeitig können. Wenn es mich nicht täuscht sind das genau gegensätzeX86 arbeitet heute intern als RISC CPU mit Mikrocode und auch ARM hat intern Mirkocode.

Hat man einen passenden Decoder, der x86 oder ARM versteht und zu passenden Mirkocode umwandelt, geht das. Genau. Bei AMD gab es mal ein entsprechendes Projekt, genannt K12. Die Zen-Prozessoren sollten eigentlich sowohl als x86-als auch als ARM-Variante gelaunched werden, mit bloß ersetztem Decoder. Nach dem Abgang von Jim Keller wurde das Projekt allerdings eingestellt.Edit2: Die Vorarbeit dazu lief unter dem Namen ProjectSkybridge und sollte die Mainboard- sowie OS-Basis legen und zwar durch ein Stock-ARM-Design, das auf AM4 lauffähig gewesen wäre.

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